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ΜP - 68000 David Saint-Mellion. Organisation interne Processeur 32 bits en interne : 8 registres de Données D7 -D0 de 32 bits Adressage sur 24 bits (16.

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1 µP David Saint-Mellion

2 Organisation interne Processeur 32 bits en interne : 8 registres de Données D7 -D0 de 32 bits Adressage sur 24 bits (16 Mo). Registres Adresses 32 bits PC : Compteur Programme, pointe sur ladresse de l instruction suivante. USP - SSP - A7 : pointeurs de pile. A7 contient le pointeur de pile de l état courant A0 - A6 : 7 registres adresses banalisés

3 Transfert - bus Adresses-Données Bus Données de 16 lignes D15 - D0. Transfert en 2 passes des objets de 32 bits. Alignement Gros Boutiste. Loctet bas stocké à une adresse impaire. Ne supporte que le mode aligné - IT « Erreur d adresse » /UDS et /LDS informations de validation bus Données Haut et Bus Données Bas. Mémoire paire Mémoire impaire A23 - A1 23 / UDS/ LDS D15 -D8 8 D7 -D0 8 µ P Bus Adresses 23 lignes A23 - A1. La ligne A0 non distribuée.

4 Protocole Principe Le protocole est asynchrone avec poignée de main Le µP marque le début de l échange en validant /AS La poignée de main : /AS - Address Strobe /DTACK Data Transfer Acknowledge µPComposant /AS=0 /DTACK=0 Poignée de Main Le composant signale quil sest acquitté des Données en validant /DTACK /AS t /DTACK t R/W sens de transfert R/W = «1» lecture R/W = «0» écriture R/W

5 Protocole - Chien de garde Le protocole peut être bloquant si le composant ne valide pas /DTACK. Un chien de garde surveille la durée du cycle bus. Il est actif lorsque /AS=0 Si le temps du cycle est trop long, le chien de garde active la borne /BERR du µP qui produit lIT « Erreur de Bus ». µPComposant /AS=0 Chien de Garde /BERR /AS t Chien de garde activé cycle bus trop longue /BERR =0 IT « Bus Erreur

6 Le Reset - Initialisation du µP Au Reset, le µp prélève dans la table des vecteurs : La valeur du pointeur de pile superviseur à «0» La valeur de ladresse de la 1ère instruction à «4» Table des vecteursµP ère instruction PC 0 - pointeur de PileSSP Le Reset se produit lorsque /HALT et /RESET passent à «1» après un temps mini de 100 ms à «0» µP /HALT /RESET /HALT /RESET t T > 100ms Linformation /HALT et /RESET est élaborée à partir de la présence de l alimentation ou de létat d un B.P. RAZ


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