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AsAd for GET front-end Caractéristiques et prospective Sommaire: - Qu’est ce que GET? - Description d’AGET - Fonctionnalités d’AsAd - Status et prospective AsAd Journées IN2P3 VLSI/FPGA/PCB Lyon – 06/2012 J.PIBERNAT 1/5
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Qu’est ce que GET? Membres de la collaboration GET Architecture hardware de GET Financement 256 → 33792canaux (Énergie/Position) Dynamiques ajustables Auto-déclenchement Taux de1khit/s Journées IN2P3 VLSI/FPGA/PCB Lyon – 06/2012 J.PIBERNAT 2/5
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Description d’AGET L’architecture GET profite des nombreuses ressources fournies par le chip AGET AGET by(P. Baron/E. Delagnes/ F. Druillole) 1 chip → 64 canaux Par voie: 1 Préamp. (4 gammes) 1Filtre (16 cst de temps) 1Mem. Analog. Circulaire 1 Discri. à seuil (8bits) 1 Hit mem. 1bit Journées IN2P3 VLSI/FPGA/PCB Lyon – 06/2012 J.PIBERNAT 3/5
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Fonctionnalité d’AsAd AsAd héberge 4 AGET (256 voies) AsAd by(Service Electronique & Acquisition) 4 ADC 12bits (ADS6422) 1FPGA (Actel A3PE1500) 1 décodeur protocole ASIC 1décodeur protocole carte gestion synchro. par PLL gestion cal. ASIC gestion entrées analog gestion ID carte gestion de l’inspection 5 Alim. sur carte avec 1 seul 3.6V Auto-protection (surveillance V,I, T°) Journées IN2P3 VLSI/FPGA/PCB Lyon – 06/2012 J.PIBERNAT 4/5
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Status & prospective AsAd Prototype V1.1 Tests fonctionnels: 100% des block OK Tests de qualification Pb convertisseur DC/DC (pompe de charge) AsAd V1.2 Journées IN2P3 VLSI/FPGA/PCB Lyon – 06/2012 Status: Prospective: Préampli externe autres applis Système très intégré pour phy. nuc: Moins de voies MAIS traitement depuis le signal jusqu’au stockage des data formatées J.PIBERNAT 5/5
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