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1 3.3 Circuits logiques à mémoire 3.3.1 Bascules (latches) Bascules SR (SR Latch) Mémoire 1-bit S Q Q R Q Q © Béat Hirsbrunner, University of Fribourg,

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1 1 3.3 Circuits logiques à mémoire Bascules (latches) Bascules SR (SR Latch) Mémoire 1-bit S Q Q R Q Q © Béat Hirsbrunner, University of Fribourg, Switzerland, 29 November 2006

2 Bascules (Latches) Définition. Dépendant de la valeur de Q, l'état d'une bascule SR est appelé 0 (zéro) ou 1 (un). SREtat Commentaire 1. Les entrées S et R d'une bascule SR sont normalement à 0. Propriété. Une bascule SR possède les états suivants: 2. Si S est mis à 1 alors Q devient 1 (Q reste à 1 si S est de nouveau mis à 0). 3. Si R est mis à 1 alors Q devient 0 (Q reste à 0 si R est de nouveau mis à 0). 4. Si S et R sont mis à 1 en même temps, puis de nouveau à 0 alors l'état final de la bascule SR est 0 ou 1 !!! 0 ou Q=Q=0

3 Bascules (Latches) Dans l'état normal S=R=0, une bascule SR se souvient si la dernière fois ce fut S ou R qui a été mis à 1 !!! Càd une bascule SR est une mémoire à 1-bit Remarque: S signifie set et R reset

4 Bascules (latches) Bascule D commandée par une horloge Bascule SR commandée par une horloge

5 Circuits flip-flop

6 6

7 Registre Fig. 3-28a. Dual D flip-flop.

8 Registre Fig. 3-28b. Octal flip-flop.

9 Organisation interne dune mémoire Figure Logic diagramm for a 4x3 memory. Each row is one of the four bit words. A read or write operation always reads or writes a complete word.

10 Organisation interne dune mémoire

11 Caractéristiques des circuits mémoire

12 RAM et ROM


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